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  • 2019/5/25二進(jìn)制編碼器
  • 二進(jìn)制編碼器是將某種信號編成二進(jìn)制代碼的電路。例如,要把,,,,,,,八個(gè)信號編成對應(yīng)的二進(jìn)制代碼而輸出,其編碼過程如下:1)確定二進(jìn)制代碼的位數(shù) 因?yàn)檩斎胗邪藗(gè)信號,所以輸出的是三位(=8,n=3)二進(jìn)制代碼。 ...[閱讀全文]
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  • 2018/12/29邏輯運(yùn)算定理
  • 常用的邏輯運(yùn)算定理如表1所示 表1 常用邏輯運(yùn)算定理 邏輯運(yùn)算定理 原等式 對偶式 交換律 A·B=B·A A+B=B+A 結(jié)合律 A(BC)=(AB)C A+(B+C)=(A+B)+C 分配律 A(B+C)=AB+AC A+BC=(A+B)(A+C) 自等律 A·1=A A+ ...[閱讀全文]
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  • 2018/12/23MOS管構(gòu)成的基本門邏輯電路
  • MOS管構(gòu)成的緩沖器Buffer和漏極開路們OD門是數(shù)字電路非常重要的概念,怎么構(gòu)成的;反相器,線與邏輯怎么玩,又怎么用呢?[閱讀全文]
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  • 2018/12/7時(shí)序邏輯電路有哪些(三款時(shí)序邏輯電路的設(shè)計(jì))
  • 時(shí)序邏輯電路有哪些(三款時(shí)序邏輯電路的設(shè)計(jì))-在數(shù)字電路中,凡是任一時(shí)刻的穩(wěn)定輸出不僅決定于該時(shí)刻的輸入,而且還和電路原來狀態(tài)有關(guān)者都叫時(shí)序邏輯電路。時(shí)序邏輯電路結(jié)構(gòu)示意圖如圖2-41所示。時(shí)序邏輯電路的狀態(tài)是靠具有存儲功能的觸發(fā)器所組成的存儲電路來記憶和表征的。[閱讀全文]
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  • 2018/12/7時(shí)序邏輯電路由什么組成_時(shí)序邏輯電路特點(diǎn)是什么
  • 時(shí)序邏輯電路由什么組成_時(shí)序邏輯電路特點(diǎn)是什么 - 全文-本文開始介紹了時(shí)序邏輯電路的特點(diǎn)和時(shí)序邏輯電路的三種邏輯器件,其次介紹了時(shí)序邏輯電路的組成與時(shí)序邏輯電路檢修方法,最后介紹了時(shí)序邏輯電路的應(yīng)用舉例。[閱讀全文]
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  • 2018/12/7組合邏輯電路的特點(diǎn)詳解
  • 組合邏輯電路的特點(diǎn)詳解-數(shù)字電路根據(jù)邏輯功能的不同特點(diǎn),可以分成兩大類,一類叫組合邏輯電路(簡稱組合電路),另一類叫做時(shí)序邏輯電路(簡稱時(shí)序電路)。組合邏輯電路在邏輯功能上的特點(diǎn)是任意時(shí)刻的輸出僅僅取決于該時(shí)刻的輸入,與電路原來的狀態(tài)無關(guān)。[閱讀全文]
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  • 2018/12/7組合邏輯電路有哪些(4款組合邏輯電路的設(shè)計(jì))
  • 組合邏輯電路有哪些(4款組合邏輯電路的設(shè)計(jì))- 若一個(gè)邏輯電路在任何時(shí)刻產(chǎn)生的穩(wěn)定輸出信號僅僅取決于該時(shí)刻的輸入信號,而與過去的輸入信號無關(guān),即與輸入信號作用前的電路狀態(tài)無關(guān),則稱該電路為組合邏輯電路。[閱讀全文]
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  • 2018/12/7基本的邏輯電路有哪些_組合邏輯電路_時(shí)序邏輯電路
  • 邏輯電路是一種離散信號的傳遞和處理,以二進(jìn)制為原理、實(shí)現(xiàn)數(shù)字信號邏輯運(yùn)算和操作的電路。分組合邏輯電路和時(shí)序邏輯電路。前者由最基本的“與門”電路、“或門”電路和“非門”電路組成,其輸出值僅依賴于其輸入變量的當(dāng)前值,與輸入變量的過去值無關(guān)—即不具記憶和存儲功能。[閱讀全文]
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  • 2018/12/7詳解 邏輯電路圖符號大全
  • 組成數(shù)字電路圖的符號可以分為兩大部分:一部分是各種數(shù)字電路和外圍元器件符號,包括圖形符號和文字符號;另一部分是導(dǎo)線、波形、輪廓等繪圖符號。它用各種圖形符號表示門、觸發(fā)器和各種邏輯部件,用線條把它們按邏輯關(guān)系連接起來,它是用來說明各個(gè)邏輯單元之間的邏輯關(guān)系和整機(jī)的邏輯功能的。為了和模擬電路的電路圖區(qū)別開來,就把這種圖叫做邏輯電路圖,簡稱邏輯圖。[閱讀全文]
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  • 2018/12/7數(shù)字邏輯電路的分類,數(shù)字邏輯電路的基本特征
  • 1.?dāng)?shù)字邏輯電路的分類按照電路所用器件的不同,數(shù)字集成電路可分為雙極型(晶體三極管型)和單極型(場效應(yīng)管型)。根據(jù)電路邏輯功能的不同,數(shù)字電路又可分為組合邏輯電路和時(shí)序邏輯電路。2.?dāng)?shù)字邏輯與數(shù)字邏輯系 ...[閱讀全文]
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  • 2018/12/7常用的時(shí)序邏輯電路
  • 常用時(shí)序邏輯電路有計(jì)數(shù)器和寄存器兩種。寄存器分為數(shù)據(jù)寄存器和移位寄存器。計(jì)數(shù)器種類較多,有同步計(jì)數(shù)器、異步計(jì)數(shù)器;有二進(jìn)制計(jì)數(shù)器、十進(jìn)制計(jì)數(shù)器、任意進(jìn)制計(jì)數(shù)器;二進(jìn)制計(jì)數(shù)器又有加法計(jì)數(shù)器、減法計(jì)數(shù)器等 ...[閱讀全文]
  • 來源:本站原創(chuàng)作者:佚名點(diǎn)擊數(shù):2384
  • 2018/11/30組合邏輯電路中的競爭冒險(xiǎn)
  • 組合邏輯電路中的競爭冒險(xiǎn)-組合邏輯電路中的競爭冒險(xiǎn)   前面分析組合邏輯電路時(shí),都沒有考慮門電路的延遲時(shí)間對電路產(chǎn)生的影響。實(shí)際上,從信號輸入到穩(wěn)定輸出需要一定的時(shí)間。由于從輸入[閱讀全文]
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  • 2018/11/3074ls138應(yīng)用電路一:全加器電路
  • 全加器有3個(gè)輸入端:a,b,ci;有2個(gè)輸出端:s,co.與3-8譯碼器比較,3-8譯碼器有3個(gè)數(shù)據(jù)輸入端:A,B,C;3個(gè)使能端;8個(gè)輸出端,OUT(0-7)。[閱讀全文]
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  • 2018/11/30邏輯電路74ls151實(shí)現(xiàn)三人表決器
  • 74ls151實(shí)現(xiàn)三人表決器 - 全文-74ls151是常用的8選1數(shù)據(jù)選擇器。本文主要介紹了74ls151引腳圖、74ls151邏輯圖及74ls151真值表,詳細(xì)的闡述了74ls151實(shí)現(xiàn)三人表決器電路。[閱讀全文]
  • 來源:本站原創(chuàng)作者:佚名點(diǎn)擊數(shù):17003
  • 2018/11/30邏輯電路74ls20實(shí)現(xiàn)的四人表決器
  • 74ls20實(shí)現(xiàn)的四人表決器 - 全文-本文開始介紹了74LS20功能表與74LS20引腳圖,其次介紹了74LS20真值表,最后詳細(xì)介紹了74ls20實(shí)現(xiàn)的四人表決器電路并對工作原理、電路仿真及調(diào)試進(jìn)行了相應(yīng)的介紹。[閱讀全文]
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  • 2018/11/24組合邏輯電路邏輯功能的描述
  • 圖的邏輯功能可寫成:  多輸入、多輸出的組合邏輯電路的框圖如圖所示。圖中a 1 ,a2 ,a3 …an表示輸入變量,y 1y2…ym表示輸出變量。輸出與輸入之間的邏輯關(guān)系可表示為: Y1=f1(a1a2…an) Y2=f2(a1a2…an) … Ym= fm (a1a2…an) ...[閱讀全文]
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  • 2018/11/24什么是組合邏輯電路?組合邏輯電路的特點(diǎn)和結(jié)構(gòu)框圖
  • 一、定義   若一個(gè)邏輯電路在任何時(shí)刻產(chǎn)生的穩(wěn)定輸出信號僅僅取決于該時(shí)刻的輸入信號,而與過去的輸入信號無關(guān),即與輸入信號作用前的電路狀態(tài)無關(guān),則稱該電路為組合邏輯電路。 二、結(jié)構(gòu)框圖   組合邏輯電路是 ...[閱讀全文]
  • 來源:本站原創(chuàng)作者:佚名點(diǎn)擊數(shù):1195
  • 2018/11/24同步時(shí)序邏輯電路的分析舉例
  • 例1 試分析圖1所示時(shí)序邏輯電路解:分析過程如下:1.寫出各邏輯方程式(1)這是一個(gè)同步時(shí)序電路,各觸發(fā)器CP 信號的邏輯表達(dá)式可以不寫。(2)輸出方程Z =Q1nQ0n(3)驅(qū)動方程J0=1 K0=1 2.將驅(qū)動方程代入相應(yīng)的JK觸發(fā)器的 ...[閱讀全文]
  • 來源:本站原創(chuàng)作者:佚名點(diǎn)擊數(shù):3302
  • 2018/11/24組合邏輯電路的險(xiǎn)象
  • 一、競爭現(xiàn)象與險(xiǎn)象的產(chǎn)生   邏輯電路中各路徑上延遲時(shí)間的長短與信號經(jīng)過的門的級數(shù)有關(guān),與具體邏輯門的時(shí)延大小有關(guān),還與導(dǎo)線的長短有關(guān),因此,輸入信號經(jīng)過不同路徑到達(dá)輸出端的時(shí)間有先有后,這種現(xiàn)象稱為 ...[閱讀全文]
  • 來源:本站原創(chuàng)作者:佚名點(diǎn)擊數(shù):1690
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